组合逻辑电路某一时刻的输出不仅取决于输入信号组合还取决于电路原来的状态 对吗?逻辑和时序的区别是什么?
组合逻辑电路某一时刻的输出不仅取决于输入信号组合还取决于电路原来的状态对吗?1对2因为组合逻辑电路的输出只取决于当前时刻的输入信号,而不受之前输入信号的影响,但如果电路有保存状态的能力(如触发器等元件),那么电路在这一时刻的输出还会取决于之前的状态......
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如果你会凌阳的编程,那这不是一个什么难题......
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